Emulation de Fautes dans les Systèmes Sécurisés

Résumé : cet article décrit une méthode pour insérer un bloc d'injection de fautes dans un système sécurisé. Plus précisément, on se propose d'embarquer ce module sur une plate-forme de prototypage FPGA. Ceci permet de simuler le comportement du système lorsque des fautes y sont injectées et ainsi de valider d'éventuelles contre-mesures. Trois modèles de fautes sont utilisés, et l'algorithme de cryptage AES sera pris comme exemple d'application. Le but d'un tel bloc est de diminuer le temps de validation des contre-mesures sur un FPGA avant passage en fonderie
Liste complète des métadonnées

https://hal-emse.ccsd.cnrs.fr/emse-00494260
Contributor : Jean-Baptiste Rigaud <>
Submitted on : Tuesday, June 22, 2010 - 3:27:03 PM
Last modification on : Monday, February 25, 2019 - 4:34:18 PM

Identifiers

  • HAL Id : emse-00494260, version 1

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Citation

Julien Francq, Jean-Baptiste Rigaud, Pascal Manet. Emulation de Fautes dans les Systèmes Sécurisés. MaJeCSTIC 2006, 2006, France. ⟨emse-00494260⟩

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